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AT86RF232
6.3 Radio Transceiver Status information
Each Atmel AT86RF232 SPI access can be configured to return status information of the
radio transceiver (PHY_STATUS) to the microcontroller using the first byte of the data
transferred via MISO.
The content of the radio transceiver status information can be configured using register
bits SPI_CMD_MODE (register 0x04, TRX_CTRL_1). After reset, the content on the
first byte send on MISO to the microcontroller is set to zero.
6.3.1 Register Description
Register 0x04 (TRX_CTRL_1):
The TRX_CTRL_1 register is a multi-purpose register to control various operating
modes and settings of the radio transceiver.
Figure 6-15 . Register TRX_CTRL_1.
Bit
7
6
5
4
0x04
Read/Write
Reset value
Bit
reserved
R/W
0
3
IRQ_2_EXT_EN
R/W
0
2
TX_AUTO_CRC_
ON
R/W
1
1
RX_BL_CTRL
R/W
0
0
TRX_CTRL_1
0x04
SPI_CMD_MODE
IRQ_MASK_MODE
IRQ_POLARITY
TRX_CTRL_1
Read/Write
Reset value
R/W
0
R/W
0
R/W
1
R/W
0
? Bit 3:2 - SPI_CMD_MODE
Each SPI transfer returns bytes back to the SPI master. The content of the first byte
(PHY_STATUS) can be configured using register bits SPI_CMD_MODE.
Table 6-4. SPI_CMD_MODE.
Register Bits
SPI_CMD_MODE
Value
0
1
2
3
Description
Default (empty, all bits zero)
Monitor TRX_STATUS register
Monitor PHY_RSSI register
Monitor IRQ_STATUS register
Note:
1.
More information to register TRX_STATUS, see Section 7.1.5 , to register
PHY_RSSI, see Section 8.3 , and to register IRQ_STATUS, see Section 6.6 .
21
8321A – MCU Wireless – 10/11
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